基于有限域的QC-LDPC碼構(gòu)造及其迭代譯碼器的FPGA設(shè)計和實現(xiàn).pdf_第1頁
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文檔簡介

1、低密度奇偶校驗碼(low density parity check, LDPC)于1962年由R.Gallager提出,是一類具有稀疏校檢矩陣的線性分組碼。但受限于當時的計算處理水平,LDPC碼長期被人們忽視,直到1996年才被Mackay、Neal等人證明其具有逼近Shannon限的性能。隨著LDPC碼研究的不斷深入,LDPC碼的一個重要的子類——QC-LDPC碼被提出,QC-LDPC碼將普通的LDPC碼進行分塊,既繼承了LDPC碼的

2、稀疏特性和隨機特性,又在每個子塊中引入了循環(huán)移位特性。在保持LDPC碼的優(yōu)良性能的前提下,大幅的降低了編譯碼的復雜度。
  本文在介紹LDPC碼的基礎(chǔ)上,引入QC-LDPC碼的概念。首先介紹了一種基于有限域的QC-LDPC碼構(gòu)造方法,并給出了適合該類型QC-LDPC碼的編碼方法和編碼器結(jié)構(gòu)。接著對LDPC碼的幾種常用譯碼算法進行介紹和分析,在TPMP譯碼算法基礎(chǔ)上重點分析了TDMP譯碼算法,并根據(jù)校驗矩陣的結(jié)構(gòu)特點對TDMP譯碼算

3、法進行改進,進一步克服冗余迭代。最后通過軟件仿真對譯碼性能進行了比較,選擇TDMP算法作為譯碼器硬件實現(xiàn)的譯碼算法,并確定硬件實現(xiàn)中的量化準則。
  在分析介紹了LDPC碼的幾種譯碼結(jié)構(gòu)的優(yōu)缺點后,根據(jù)本文采用的QC-LDPC碼的結(jié)構(gòu)特點,采用改進的分層譯碼結(jié)構(gòu)來設(shè)計譯碼器,并詳細介紹LDPC碼譯碼器整體結(jié)構(gòu)及各個子模塊的功能,使用Verilog硬件描述語言,完成譯碼器的設(shè)計。使用QuartusⅡ軟件對Altera公司的EP3SE

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