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1、分類號(hào)：UDC：TN40262138密級(jí)：亙壘五編號(hào)：——基于FPGA的KLT算法設(shè)計(jì)與實(shí)現(xiàn)DESIGNANDIM_PLEMENTATIoNoFKIJALGORITHMBASEDONFPGA學(xué)位授予單位及代碼：蓬壹堡王太堂!!Q!壘魚2學(xué)科專業(yè)名稱及代碼：電王抖堂皇撞查!魚壘Q璺2論文起止時(shí)間：呈蛆l!魚二星盟量』至申請(qǐng)學(xué)位級(jí)別：工學(xué)碩士摘要KLT(Kanade—Lucas—Tomasi)算法計(jì)算量大，實(shí)時(shí)性要求高，在實(shí)際應(yīng)用中，基于現(xiàn)
2、場(chǎng)可編程門陣列FPGA(FieldProgrammableGateArray)的KLT算法設(shè)計(jì)與實(shí)現(xiàn)顯得尤為重要。本文充分利用FPGA的流水線操作、高度并行性以及高數(shù)據(jù)吞吐率等特性，高效快速地實(shí)現(xiàn)KLT算法，包括KLT特征點(diǎn)檢測(cè)算法和KLT特征點(diǎn)跟蹤算法。用硬件FPGA設(shè)計(jì)并實(shí)現(xiàn)KLT特征點(diǎn)檢測(cè)算法需完成四個(gè)功能模塊，即平滑濾波模塊、梯度設(shè)計(jì)實(shí)現(xiàn)模塊、特征值計(jì)算模塊以及本地非最大化抑制模塊，KLT特征點(diǎn)跟蹤算法需完成兩大功能模塊，即逆矩
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