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![基于FPGA的局部動態(tài)可重構(gòu)系統(tǒng)設(shè)計(jì).pdf_第1頁](https://static.zsdocx.com/FlexPaper/FileRoot/2019-3/14/18/440e4679-8b43-41fb-9ebd-6556d1083c6e/440e4679-8b43-41fb-9ebd-6556d1083c6e1.gif)
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文檔簡介
1、可重構(gòu)計(jì)算是具備設(shè)計(jì)后芯片定制能力和能在很大程度上實(shí)現(xiàn)軟件算法到硬件計(jì)算設(shè)備空間映射特點(diǎn)的計(jì)算機(jī)組織結(jié)構(gòu)。作為一種新型的數(shù)字電路設(shè)計(jì)概念,可重構(gòu)計(jì)算兼容了硬件計(jì)算速度快和軟件設(shè)計(jì)的靈活性等特點(diǎn)。局部動態(tài)可重構(gòu)指的是當(dāng)可重構(gòu)系統(tǒng)在運(yùn)行時,其中某個功能模塊按照預(yù)定義的方式進(jìn)行重配置,且不影響系統(tǒng)整體的正常運(yùn)行。局部動態(tài)可重構(gòu)通過實(shí)現(xiàn)模塊的配置與運(yùn)行的并行處理,一定程度上彌補(bǔ)了可重構(gòu)計(jì)算因配置而在時間上的開銷。隨著FPGA制造工藝的高速發(fā)展,
2、局部動態(tài)可重構(gòu)技術(shù)逐漸成為當(dāng)代嵌入式計(jì)算的研究和發(fā)展的重要方向。
本文研究的重點(diǎn)是在ML403 Virtex-4開發(fā)平臺上設(shè)計(jì)與實(shí)現(xiàn)局部動態(tài)可重構(gòu)系統(tǒng),將加解密算法MD5和SHA-256在動態(tài)可重構(gòu)區(qū)域中實(shí)現(xiàn),并把結(jié)果與普通FPGA硬件計(jì)算進(jìn)行比較,針對資源占用情況、穩(wěn)定性和容錯性進(jìn)行分析;但硬件系統(tǒng)往往會占用一些配置時間,而軟件系統(tǒng)則無需配置過程,所以在實(shí)時任務(wù)系統(tǒng)中可以選擇軟硬件任務(wù)協(xié)同分配,本文構(gòu)建了軟硬件協(xié)同的動態(tài)
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